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出版社名:共立出版
出版年月:2020年10月
ISBN:978-4-320-12463-9
421P 26cm
SystemVerilog入門 設計・仕様・検証のためのハードウェア記述言語
篠塚一也/著
組合員価格 税込 6,897
(通常価格 税込 7,260円)
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内容紹介・もくじなど
もくじ情報:概要;設計および検証のためのビルディングブロック;データタイプ;メンバーで構成されるデータタイプ;クラス;プロセス;代入文;オペレータと式;実行文;タスクとファンクション〔ほか〕
もくじ情報:概要;設計および検証のためのビルディングブロック;データタイプ;メンバーで構成されるデータタイプ;クラス;プロセス;代入文;オペレータと式;実行文;タスクとファンクション〔ほか〕
著者プロフィール
篠塚 一也(シノズカ カズヤ)
1972年名古屋大学理学研究科数学修士課程修了。現在、(有)アートグラフィックスEDA開発部アーキテクト。専門、言語設計、コンパイラ開発、RTL論理合成、SystemVerilog設計・検証ツール開発;クロッキングブロック;プロセス間の同期と交信;チェッカー;プログラム;インターフェース;パッケージ;モジュール;システムタスクとシステムファンクション;制約によるランダムスティミュラスの生成;SystemVerilogの検証機能;モデリングと検証;UVM概説;コンパイラディレクティブ;シミュレーション実行モデル(本データはこの書籍が刊行された当時に掲載されていたも…(続く
篠塚 一也(シノズカ カズヤ)
1972年名古屋大学理学研究科数学修士課程修了。現在、(有)アートグラフィックスEDA開発部アーキテクト。専門、言語設計、コンパイラ開発、RTL論理合成、SystemVerilog設計・検証ツール開発;クロッキングブロック;プロセス間の同期と交信;チェッカー;プログラム;インターフェース;パッケージ;モジュール;システムタスクとシステムファンクション;制約によるランダムスティミュラスの生成;SystemVerilogの検証機能;モデリングと検証;UVM概説;コンパイラディレクティブ;シミュレーション実行モデル(本データはこの書籍が刊行された当時に掲載されていたものです)