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出版社名:共立出版
出版年月:2026年1月
ISBN:978-4-320-12592-6
227P 26cm
SystemVerilogによるモデリングと論理合成 ハードウェア記述言語による回路設計の基礎
篠塚一也/著
組合員価格 税込 4,554
(通常価格 税込 5,060円)
割引率 10%
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内容紹介・もくじなど
もくじ情報:第1章 概要;第2章 設計に必要なSystem Verilogの基礎知識;第3章 ブール代数と論理合成;第4章 論理合成とalways;第5章 エンコーディング;第6章 整数表現と演算;第7章 組み合わせ回路と論理合成;第8章 ラッチ;第9章 シーケンシャル回路と論理合成;第10章 FSM;第11章 練習問題の解答
もくじ情報:第1章 概要;第2章 設計に必要なSystem Verilogの基礎知識;第3章 ブール代数と論理合成;第4章 論理合成とalways;第5章 エンコーディング;第6章 整数表現と演算;第7章 組み合わせ回路と論理合成;第8章 ラッチ;第9章 シーケンシャル回路と論理合成;第10章 FSM;第11章 練習問題の解答
著者プロフィール
篠塚 一也(シノヅカ カズヤ)
1970年 東京理科大学理学部数学科卒業。2006年 日本に帰国し、自社アートグラフィックスのEDA製品開発を担当し、現在に至る(本データはこの書籍が刊行された当時に掲載されていたものです)
篠塚 一也(シノヅカ カズヤ)
1970年 東京理科大学理学部数学科卒業。2006年 日本に帰国し、自社アートグラフィックスのEDA製品開発を担当し、現在に至る(本データはこの書籍が刊行された当時に掲載されていたものです)